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本發(fā)明公開了一種格雷碼編解碼并行電路，包括：N個(gè)二選一選擇器和N+1個(gè)異或運(yùn)算單元，一個(gè)二選一選擇器和一個(gè)異或運(yùn)算單元組成一個(gè)數(shù)據(jù)選擇及運(yùn)算的基本單元；二選一選擇器受控制信號(hào)控制為異或運(yùn)算單元選擇輸入數(shù)據(jù)，第M個(gè)二選一選擇器接收外部數(shù)據(jù)和第...該專利屬于上海華虹集成電路有限責(zé)任公司所有，僅供學(xué)習(xí)研究參考，未經(jīng)過上海華虹集成電路有限責(zé)任公司授權(quán)不得商用。