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本發明提供一種NRZI編碼的并行設計電路，由一個二選一選擇器和八個同或運算單元構成，輸入位寬為8比特。二選一選擇器在同步信號sync的控制下輸入NRZI編碼運算的初始值，八個同或運算單元XNOR采樣外部輸入的八位數據，同時進行同或運算并產生...該專利屬于上海華虹集成電路有限責任公司所有，僅供學習研究參考，未經過上海華虹集成電路有限責任公司授權不得商用。
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本發明提供一種NRZI編碼的并行設計電路，由一個二選一選擇器和八個同或運算單元構成，輸入位寬為8比特。二選一選擇器在同步信號sync的控制下輸入NRZI編碼運算的初始值，八個同或運算單元XNOR采樣外部輸入的八位數據，同時進行同或運算并產生...